# Verilog编程技巧

**Repository Path**: xuxiaokang/Verilog-Coding-Techniques

## Basic Information

- **Project Name**: Verilog编程技巧
- **Description**: Verilog与SV编程技巧
- **Primary Language**: Verilog
- **License**: MIT
- **Default Branch**: master
- **Homepage**: None
- **GVP Project**: No

## Statistics

- **Stars**: 0
- **Forks**: 0
- **Created**: 2025-03-17
- **Last Updated**: 2025-03-18

## Categories & Tags

**Categories**: Uncategorized

**Tags**: None

## README

# Verilog编程技巧

## 前言

Verilog编程技巧系列文章将聚焦于介绍Verilog的各种编程范式或者说技巧，编程技巧和编程规范有部分重合，但并非完全一样。规范更注重编码的格式，像变量命名、缩进、注释风格等，而编程技巧则更偏重更直观易读、更便于维护、综合效果更好的Verilog/SV代码写法，像：如何编写状态机、如何进行参数化设计、如何进行流水线设计等。可以说编程技巧就是一些编程套路，熟练掌握这些技巧可帮助我们更高效的完成FPGA开发工作。

## 更多参考

[Verilog编程技巧01——如何编写三段式状态机 – 徐晓康的博客](https://www.myhardware.top/verilog编程技巧01-如何编写三段式状态机/)

## 其它平台

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