Watch aheck/乱序RISCV CPU

Watch aheck/DigitalLockInAmplifier

Verilog实现数字锁相放大器。

Watch aheck/Five Stages Pipeline RISCV Processor

risc-v架构五级流水线cpu，完成基本功能

Watch aheck/骆驼大赛

Watch aheck/python-client

Watch aheck/riscv_cpu

Watch aheck/企业级RTL代码风格怪谈

企业级RTL代码风格原来长这样！！！！以前的verilog都白写了！！！

Watch aheck/esp32-alcohol-breathalyzer

ESP32芯片识别呼气是否有酒精

Watch aheck/Unity-Startmenus

基于Unity游戏引擎的游戏开始画面，现在不想写了，私密马赛

Watch aheck/ahblite-interrupt-max-gcd

在Anlogic DMZ-EG4S20 FPGA上搭建基于Cortex-M0软核的片上系统，设计求最大公约数的硬件加速器，使用通道加速器模式耦合到AHB-lite总线上。同时进行矩阵键盘和数码管的RTL设计。最后在keil上编写汇编语言和C语言程序，烧录进FPGA中实现求最大公约数的功能。