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包含基于ZYNQ7020 FPGA的硬件程序，也包含能够使用千兆以太网进行数据和波形显示的APP上位机 数据格式如下：81 48 17 80 38 08 81 00为一次ADC采集时钟采集到的数据，为64bit的数据，其中64bit的数据可以拆分成5个通道的12bit的ADC采集数据和末尾补全的0000

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头戴第二版，主控esp32程序

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