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第十章 Trap和Exception 中对 mtvec 向量模式的疑问
已完成
#I55JRV
Fan Shupei
创建于
2022-05-01 23:46
在观看视频 P20 第10章 Trap和Exception 中关于 mtvec 的寄存器功能的解释 （对应视频约 12:00-15:00），对其 vectored mode 的工作原理解释是不太确切的。 对应课件部分展示的是 riscv spec 的截图，这是没有问题的，而语言解释则不太准确。视频中的解释容易被理解为 vector table 存放的 interrupt handler 的地址，在 interrupt 发生时先进行一次间接寻址得到对应的 interrupt handler 的地址，再将其设定为 pc 的值，这是不正确的。 正确的解释是，在 vectored mode 下，中断发生时直接设置 pc = BASE + 4*cause。中断向量表中的并非是 interrupt handler 的地址，而是若干 j 指令，j 指令负责跳转到对应的 interrupt handler 然后开始执行。这一点 riscv 可能和其他 ISA 的中断向量表不一样。 https://starfivetech.com/uploads/sifive-interrupt-cookbook-v1p2.pdf 这一个链接中的 P13/P14 给出了一个很直观的例子，riscv CLINT 模式的中断向量表存放的是一系列的 j 指令。
在观看视频 P20 第10章 Trap和Exception 中关于 mtvec 的寄存器功能的解释 （对应视频约 12:00-15:00），对其 vectored mode 的工作原理解释是不太确切的。 对应课件部分展示的是 riscv spec 的截图，这是没有问题的，而语言解释则不太准确。视频中的解释容易被理解为 vector table 存放的 interrupt handler 的地址，在 interrupt 发生时先进行一次间接寻址得到对应的 interrupt handler 的地址，再将其设定为 pc 的值，这是不正确的。 正确的解释是，在 vectored mode 下，中断发生时直接设置 pc = BASE + 4*cause。中断向量表中的并非是 interrupt handler 的地址，而是若干 j 指令，j 指令负责跳转到对应的 interrupt handler 然后开始执行。这一点 riscv 可能和其他 ISA 的中断向量表不一样。 https://starfivetech.com/uploads/sifive-interrupt-cookbook-v1p2.pdf 这一个链接中的 P13/P14 给出了一个很直观的例子，riscv CLINT 模式的中断向量表存放的是一系列的 j 指令。
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git@gitee.com:unicornx/riscv-operating-system-mooc.git
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