一个从零开始写的极简、非常易懂的RISC-V处理器核。

HDLGen是一个HDL生成工具，支持在Verilog里内嵌Perl或Python script来帮助快速、高效地生成期望的设计，支持Perl或者Python的所有数据结构和语法，有若干内嵌函数来提高效率，也支持Perl的扩展API(Python API扩展目前还不支持)，通过内嵌script和API来减少手动工作、提高开发效率、降低出错几率。

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Vostok RV64GC SoC RV-AT's 5th Gen RISC-V SoC Solution

verilog 异步fifo

Verilog PCI express components